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合集 · 【清华大学】数字超大规模集成电路设计
(127集)
第49集
第五章 #数字集成度的功耗 5.3 CMOS逻辑门的静态功耗(1)
12:18
第50集
第五章 #数字集成度的功耗 5.3 CMOS逻辑门的静态功耗(3)
18:45
第51集
第五章 #数字集成度的功耗 5.4 功耗优化威廉希尔官方网站 (1)
16:07
第52集
第五章 #数字集成度的功耗 5.3 CMOS逻辑门的静态功耗(4)
09:52
第53集
第五章 #数字集成度的功耗 5.4 功耗优化威廉希尔官方网站 (2)
14:37
第54集
第五章 #数字集成度的功耗 5.4 功耗优化威廉希尔官方网站 (3)
17:18
第55集
第六章 #互连线 6.1 集成电路的互连线(1)
07:59
第56集
第六章 #互连线 6.1 集成电路的互连线(2)
07:28
第57集
第五章 #数字集成度的功耗 5.4 功耗优化威廉希尔官方网站 (4)
20:48
第58集
第六章 #互连线 6.1 集成电路的互连线(3)
07:27
第59集
第六章 #互连线 6.1 集成电路的互连线(4)
06:09
第60集
第六章 #互连线 6.2 互连线延时模型(1)
07:03
第61集
第六章 #互连线 6.2 互连线延时模型(2)
18:44
第62集
第六章 #互连线 6.2 互连线延时模型(3)
07:38
第63集
第六章 #互连线 6.3 互连线的信号完整性问题(2)
08:12
第64集
第六章 #互连线 6.3 互连线的信号完整性问题(1)
23:02
第65集
第六章 #互连线 6.3 互连线的信号完整性问题(3)
16:15
第66集
第六章 #互连线 6.3 互连线的信号完整性问题(5)
06:55
第67集
第六章 #互连线 6.3 互连线的信号完整性问题(4)
17:42
第68集
第七章 #组合逻辑门的设计 7.0 引言
03:22
第69集
第六章 #互连线 6.4 互连线的Scaling Down
14:33
第70集
第七章 #组合逻辑门的设计 7.1 静态互补CMOS逻辑的特点
11:32
第71集
第七章 #组合逻辑门的设计 7.2 有比逻辑(1)
18:46
第72集
第七章 #组合逻辑门的设计 7.2 有比逻辑(2)
16:15
第73集
第七章 #组合逻辑门的设计 7.2 有比逻辑(3)
06:38
第74集
第七章 #组合逻辑门的设计 7.2 有比逻辑(4)
23:50
第75集
第七章 #组合逻辑门的设计 7.3 传输管逻辑(2)
10:10
第76集
第七章 #组合逻辑门的设计 7.3 传输管逻辑(1)
29:15
第77集
第七章 #组合逻辑门的设计 7.3 传输管逻辑(4)
05:47
第78集
第七章 #组合逻辑门的设计 7.3 传输管逻辑(5)
13:14
第79集
第七章 #组合逻辑门的设计 7.3 传输管逻辑(3)
30:35
第80集
第七章 #组合逻辑门的设计 7.4 动态逻辑(1)
01:32
第81集
第七章 #组合逻辑门的设计 7.3 传输管逻辑(6)
18:52
第82集
第七章 #组合逻辑门的设计 7.4 动态逻辑(2)
15:36
第83集
第七章 #组合逻辑门的设计 7.4 动态逻辑(4)
13:10
第84集
第七章 #组合逻辑门的设计 7.4 动态逻辑(5)
08:29
第85集
第七章 #组合逻辑门的设计 7.4 动态逻辑(7)
05:45
第86集
第七章 #组合逻辑门的设计 7.4 动态逻辑(8)
20:37
第87集
第七章 #组合逻辑门的设计 7.5 组合逻辑类型的选择
14:13
第88集
第八章 #时序逻辑 8.1 时序逻辑和时序单元
10:52
第89集
第八章 #时序逻辑 8.2 静态时序单元(1)
07:32
第90集
第八章 #时序逻辑 8.2 静态时序单元(2)
13:43
第91集
第八章 #时序逻辑 8.2 静态时序单元(3)
12:47
第92集
第八章 #时序逻辑 8.3 时序参数(1)
23:06
第93集
第八章 #时序逻辑 8.3 时序参数(2)
12:18
第94集
第八章 #时序逻辑 8.4 动态时序单元
15:17
第95集
第八章 #时序逻辑 8.5 本章总结
03:43
第96集
第九章 #时钟威廉希尔官方网站 9.1 同步时序逻辑的时钟(1)
15:43
第97集
第九章 #时钟威廉希尔官方网站 9.2时钟偏差和时钟抖动(2)
12:41
第98集
第九章 #时钟威廉希尔官方网站 9.2时钟偏差和时钟抖动(1)
22:36
