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RISC-V架构下DSA-AI算力的更多可能性：Banana Pi BPI-F3进迭时空

Banana Pi BPI-F3 进迭时空 K1开发板AI人工智能应用：四路视频同时推理演示：香蕉派BPI-F3是一款工业级 8核RISC-V开源硬件开发板，它采用进迭时空（SpacemiT） K1 8核RISC-V芯片设计，CPU集成2.0 TOPs AI计算能力。2/4/8/16G DDR和8/16/32/128G eMMC。2个GbE以太网接口，4个USB 3.0和PCIe M.2接口，支持HDMI和双MIPI-CSI摄像头。

发表于09-07 10:30 • 2479
RISCV 操作常见问题集 - v5

（1）如果工程直接复制另一个工程，路径一定要修改，建议重新eclipse工程。（2）clean Project时提示 rm: can't remove 'build/dhrystone.elf': Permission denied 正在使得该elf文件，上次的JTAG链接没有断开。此时可以先关闭c/c++工作界面，再重新添加C/C++ (default),然后在Console中关闭上次的链接。（3）Debug session'default' already started。先关闭c/c++工作界面，再重新添加C/C++ (default),然后在Console中关闭上次的链接。 (3) Memory region Used Size Region Size %age Used c:

发表于09-09 18:14 • 650
探秘四大主流芯片架构：谁将主宰未来科技？

在科技日新月异的今天，芯片作为现代电子设备的心脏，其架构的选择与设计显得尤为重要。目前市场上主流的芯片架构有四种：X86、ARM、RISC-V和MIPS。它们各具特色，广泛应用于各种电子设备中。本文将详细剖析这四大主流芯片架构的特点、优势及应用领域。

发表于07-31 11:15 • 2667
RISC-V编译环境搭建

以上按位数分可以编译为32位和64位两种，另外就是都可以编译为elf版本和linux版本。

发表于07-17 11:31 • 1345
开源鸿蒙编译OpenHarmony轻量系统QEMU RISC-V版本

本文将介绍如何为QEMU RISC-V虚拟平台构建OpenHarmony轻量系统。得益于QEMU的CPU指令集模拟执行能力，该方法可以在没有开发板的情况下调试和运行OpenHarmony系统源码。本文介绍的该方法，可以用于OpenHarmony操作系统源码的学习和研究。

发表于07-15 10:36 • 1062
Ubuntu现已在首款信用卡大小的RISC-V单板计算机Milk-V Mars上运行

2024年5月28日——Canonical宣布优化的 Ubuntu 24.04 镜像已可用于 Milk-V Mars ——深圳市群芯闪耀科技有限公司推出的首款信用卡大小的高性能 RISC-V 单板计算机（SBC）。 RISC-V：芯片开发的新范式在各行业中，开放标准和协作对硬件和软件至关重要，并在重塑我们的世界方面发挥了重要作用。RISC-V 是历史上最广泛和最开放的指令集架构（ISA），促使硬件社区在这一层面上接受了开放标准和协作。这种开放的 ISA 通过开放标准的协作和快速的行业范围内的采用，

发表于05-31 15:02 • 7363
如何快速上手进迭时空K1 RISC-V开发板：Banana Pi BPI-F3

BananaPi BPI-F3采用K1内核、SPM8821 PMIC+外部DCDC供电方案。存储采用LPDDR4X和eMMC。外围设备有 PCIe 2.0 2 Lane M.2 KEY M、PCIe 2.0 1 Lane MINI PCIe、4xUSB3.0 TYPE-A、WIFI/BT、TF Card、HDMI TX、MIPI DSI、MIPI CSI、TYPE-C、 2xRJ45等集成，集成稳定且可扩展的解决方案。

发表于05-16 12:08 • 1262
Devkit# 一款RISC-V AI摄像头开发套件，配备高达500万像素摄像头、2.3英寸彩色触摸屏显示器、GPIO

Sipeed MaixCAM是一款基于SOPHGO SG 2002 RISC-V（和Arm，以及8051）SoC的AI相机，具有1 TOPS NPU，最多可容纳500万像素相机模块，并配备2.3英寸彩色触摸屏显示器。该开发套件还配备了WiFi 6和BLE 5.4连接、可选以太网、音频输入和输出端口、USB Type-C端口以及两个用于扩展的14引脚GPIO接头，使其适用于一系列计算机视觉、智能音频和AIoT应用。 Sipeed MaixCAM规格： SoC - [SOPHGO SG 2002] CPU 运行Linux的1 GHz RISC-V C906处理器或Arm Cortex-A53内核（在靴子时可选）运行RTOS的700 MHz RISC—

发表于05-10 14:21 • 8405
RISC-V的中断处理中断操作三个步骤

中断操作三个步骤： 1、中断初始化 2、trap处理 3、用户中断处理

发表于05-20 16:38 • 1203
RISCV soft JTAG调试_v1.2

因为目前软件的限制，RISCV的逻辑不能同时共用JTAG，所以如果想要同时去调试逻辑和RISCV的话，可以通过RISCV的soft Jtag来实现。soft Jtag就是通过GPIO来实现的软件JTAG。这里我们以TI60F225 DEMO来演示。在使用softJTAG的过程中，首先要把RISCV的IP的调试选项选择为soft,也就是Eanble Soft Debug Tap. 第二，使用softjtag 在通过openOCD来配置时要选择default_softTap，它对应“embedded_swsapphire_socconfig”下面的default_softTap.launch文件。第三个要注意的点就是器件的名称。如果使用的是

发表于04-23 08:38 • 1058

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