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电子发烧友网>电子资料下载>可编程逻辑>FPGA/ASIC>XC2C128 CoolRunner-II CPLD的详细数据手册资料说明

XC2C128 CoolRunner-II CPLD的详细数据手册资料说明

2019-02-26 | rar | 0.27 MB | 次下载 | 免费

资料介绍

  CoolRunner II 128宏单元设备设计用于高性能和低功耗应用。这为高端通信设备节省了电能,为电池驱动的设备提供了高速电能。由于低功耗的备用和动态运行,提高了系统的整体可靠性。

  该设备由八个功能块组成,通过低功耗高级互连矩阵(AIM)相互连接。AIM向每个功能块提供40个真输入和补充输入。功能块由一个40×56的p-term pla和16个宏单元组成,这些宏单元包含许多允许组合或注册操作模式的配置位。

  此外,这些寄存器可以全局复位或预设,并配置为D或T触发器或D锁存器。还有多个时钟信号,包括全局和本地产品术语类型,都是以每个宏单元为基础配置的。输出引脚配置包括转换速率限制、总线保持、上拉、开漏和可编程接地。施密特触发器输入在每个输入引脚的基础上可用。除了存储宏单元输出状态外,宏单元寄存器还可以配置为直接输入寄存器,以直接存储来自输入端的信号。

  时钟可在全局或功能块的基础上使用。三个全局时钟可作为同步时钟源用于所有功能块。宏单元寄存器可以单独配置为通电至零或一个状态。全局设置/重置控制线也可用于在操作期间异步设置或重置所选寄存器。可使用每个宏单元或每个功能块的产品术语来形成额外的本地时钟、同步时钟启用、异步设置/重置和输出启用信号。

  在每个宏单元的基础上,还提供了双边缘触发器功能。此功能允许高性能同步

  基于低频时钟的操作,有助于降低设备的总功耗。

  电路还包括将一个外部提供的全球时钟(GCK2)除以八个不同的选择。这将产生除以偶数和奇数时钟频率的结果。

  使用时钟分频(除以2)和双边缘触发器可以产生CoolClock功能。

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