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在Cadence Allegro/OrCAD PCB SI中，我们可以方便地提取PCB上的传输线及过孔的模型进入到Cadence SigXplorer中，即可清晰明了地看到各段传输线的特征阻抗等参数。但是，整个传输通道中，并不是所有部分都提供了.brd或.mcm这些Cadence所支持的电路板或衬底设计文件，例如，连接器厂商针对高速接插件通常会提供S参数或Spice模型，我们并不能够直接从这些模型中直接看出其阻抗特性，也就不能直观的了解这部分传输通路是否会因为阻抗不连续而引起信号的反射。这时，我们可以执行TDR仿真，即针对这部分电路或整个传输通道搭建一个TDR（Time Domain Refletometer，时域反射仪）环境，然后添加一个极短上升时间（一般100ps以内）、输出阻抗为定值（一般是单边50ohm和差分100ohm）的激励，测量输出端口的电压曲线，并可分析得出待测电路（DUT）的阻抗特性。 Cadence Allegro/OrCAD PCB SI和业界多数SI仿真工具一样，都支持TDR仿真，我们可以在SigXplorer中仿真分析待测电路的阻抗特性。
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