TMS320VC5402A 定点数字信号处理器

• 具有三个独立的16位数据存储器总线和一个程序存储器总线的高级多总线架构
• 40位算术逻辑单元（ALU）包括一个40位桶形移位器和两个独立的40位累加器
• 17-×17位并行乘法器耦合到一个40位专用加法器，用于非流水线单周期乘法/累积（MAC）操作
• 比较，选择和存储单元（CSSU）以进行维特比算子的添加/比较选择
• 指数编码器以计算40的指数值单周期位累加器值
• 具有8个辅助寄存器和2个辅助寄存器算术单元（ARAU）的两个地址发生器
• 具有总线保持器功能的数据总线
• 8M×16位最大可寻址外部程序空间的扩展寻址模式
• 16K x 16位片上RAM组成：
  • 两块8K×16位开 - 芯片双重访问程序/数据RAM
• 1配置为程序存储器的6K×16位片上ROM
• 增强型外部并行接口（XIO2）
• 程序代码的单指令重复和块重复操作
• 用于更好程序和数据管理的块存储器移动指令
• 使用32位长字操作数的指令
• 具有两个或三个操作数读取的指令
• 并行存储和并行加载的算术指令
• 条件存储指令
• 快速从中断返回
• 片上外设
  • 软件可编程等待状态发生器和可编程存储区切换
  • 具有内部振荡器或外部时钟源的片上可编程锁相环（PLL）时钟发生器^（1）
  • 一个16位定时器
  • 六通道直接内存访问（DMA）控制器
  • 三个多通道缓冲串行端口（McBSP）
  • 8/16位增强型并行主机端口接口（HPI8 /16）
• P
• CLKOUT关闭控制以禁用CLKOUT
• 基于片上扫描的仿真逻辑，IEEE Std 1149.1 ^（2）（JTAG）边界扫描逻辑
• 144针球栅阵列（BGA）[GGU后缀]
• 144针低剖面四方扁平封装（ LQFP）（PGE后缀）
• 6.25-ns单周期定点指令执行时间（160 MIPS）
• 3.3-VI /O电源电压
• 1.6V核电源电压

^（1）所有5402A器件均不提供片内振荡器。有关适用的器件，请参阅TMS320vC5402A数字信号处理器芯片勘误表（文献编号SPRZ018）
^（2） IEEE标准1149.1-1990标准测试访问端口和边界扫描架构。
注意：本数据手册旨在与TMS320C54x™ DSP功能概述（文献编号SPRU307）结合使用。

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