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本人小白，使用virtex-7 VX485t开发套件，做了一个很简单的LED灯的verilog程序，就是时钟一进来，LED就一直闪（一直取反）
在设置管脚的时候，查到到了SysClk的P级引脚是E19，于是设置了引脚，IOSTANDARD我看到官方文档说是LCDS，但是我设置的时候没有LVDS选项，于是我选择了LVCMOS18和LVDCI18分别尝试了，但是都不行，烧录到版主上面完全没反应，于是又改成了使用UserClk的P级引脚AK34，但是仍然不行。。。 试过使用非时钟触发，LED灯就会一直亮，所以LED管脚应该没有错，使用时钟的时候，用了PLL，输入为200Mhz（因为SysClk的晶振是200M），输出为100Mhz作为时钟。 所以到底是哪里出问题了呢？？？？ 百思不得其解？？？ 
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8个回答
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会不会是灯闪的频率太快人眼看不出来。。。
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是不是楼主所设振荡频率过高造成的
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2016-9-21 09:34:48
评论
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振荡频率不是晶振决定的吗？我查过官方文档，SysClk对应的是SIT9102AI-243N25E200，就是200M的晶振 |
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2016-9-21 09:36:53
评论
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是不是频率太快了
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2016-9-21 14:29:14
评论
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那就爱莫能助了 如果楼主解决了 还望分享一下经验 |
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学习学习学习
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设置成哪个引脚不得看你晶振在哪个引脚上接着，你这么随便改是出于什么想法？。。。。
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2017-3-19 08:55:26
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