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我每次仿真一个.v文件都要置顶重新编译,不然那么多.v文件,人家怎么知道你要仿真哪一个?
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建议用se版本,这样做的话,xilinx和altera都能适用。
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可能采用quartus+modelsim联合仿真这种方式时,modelsim是从顶层文件开始查找待测试的入口,我这个工程还没有在顶层模块中将待测试模块例化,记得以前如果在顶层文件中将待测试模块例化,也是可以出结果的 |
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嗯嗯,我前天也安装了modelsim se 版本的,但是好像不能从quartus里一键调过去 |
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update 发表于 2016-08-07 20:26 我也是这么认为 |
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你没有体验到用se版本的好处,do文件的使用真的很爽! |
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update 发表于 2016-8-7 20:26 你对系统内部的子模块仿真就需要把对应的模块设置成顶层模块 |
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噢噢,目前还没用过.do文件,不过se版本的好像可以支持VHDL和Verilog的混合仿真 |
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我找到原因了,只要在顶层模块里把子模块例化,就可以对子模块仿真了,不需要设顶层 |
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