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数字钟综合实验及原理
times New="New" Roman'">一、设计要求(数字钟的功能) 1、具有时、分、秒计数显示功能,以二十四小时循环计时。 2、具有清零,调节小时,分钟的功能。 3、具有整点报时同时LED灯花样显示的功能。 二、实验目的 1、掌握多位计数器相连的设计方法。 2、掌握十进制,六进制,二十四进制计数器的设计方法。 3、继续巩固多位共阴极扫描显示数码管的驱动,及编码。 4、掌握扬声器的驱动。 5、LED灯的花样显示。 6、掌握CPLD威廉希尔官方网站 的层次化设计方法。 三、硬件要求 1、主芯片Altera EPM7128SLC84-15。 2、8个LED灯。 3、扬声器。 4、8位8段扫描共阴极数码显示管。 5、三个按键开关(清零,调小时,调分钟)。 四、实验原理 在同一CPLD芯片上集成了如下电路模块: 1、时钟计数:秒……60进制BCD码计数。 分……60进制BCD码计数。 时……24进制BCD码计数。 同时整个计数器有清零、调时、调分功能。在接近整数时能提供报时信号。 2、具有驱动8位8段共阴极扫描数码管的片选驱动信号输出和8段字形译码输出。编码和扫描可参考“实验四”。 3、扬声器在整点时有报时驱动信号产生(响声持续多长时间?)。 4、LED灯按个人口味在整点时有花样显示信号产生。 五、实验内容及步骤 1、根据电路特点,可在教师指导下用层次设计概念。将此设计任务分成若干模块,规定每一模块的功能和各模块之间的接口。让几个学生分做和调试其中之一,然后再将各模块和起来联试。以培养学生之间的合作精神,同时加深层次化设计概念。 2、了解软件的元件管理深层含义,以及模块元件之间的连接概念,对于不同目录下的同一设计,如何熔合。 六、原理图 如图9-1所示(模块化设计) |
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