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FPGA外接DDR3，带宽怎么计算？

14323 控制器接口

问答对人有帮助，内容完整，我也想知道答案 0 DDR3的理论带宽怎么计算？用xilinx的控制器输入时钟200M。 FPGA与DDR的接口如下： 0
2016-2-17 18:17:40　　评论淘帖0 邀请回答您可以邀请以下用户，快速回答问题 × 刘英该类别下有 31 个回答。邀请回答 chenbingjy 该类别下有 27 个回答。邀请回答 yoonssica 该类别下有 22 个回答。邀请回答 houxiaoxiao 该类别下有 17 个回答。邀请回答小工兵该类别下有 16 个回答。邀请回答小萃米该类别下有 16 个回答。邀请回答 Elecfans管家该类别下有 15 个回答。邀请回答我爱妖妖该类别下有 14 个回答。邀请回答言尽于此33 该类别下有 14 个回答。邀请回答薄迪该类别下有 14 个回答。邀请回答 hxing 该类别下有 13 个回答。邀请回答那些年儿ing 该类别下有 13 个回答。邀请回答平漂流该类别下有 13 个回答。邀请回答小麦地该类别下有 12 个回答。邀请回答科比如我该类别下有 12 个回答。邀请回答倪love 该类别下有 12 个回答。邀请回答 xiekaboy 该类别下有 12 个回答。邀请回答 1653344032.827400 该类别下有 12 个回答。邀请回答 2013crazy 该类别下有 11 个回答。邀请回答英雄孤寂该类别下有 11 个回答。邀请回答举报 yangtuzi2016 相关推荐 • 请问为什么DSP需要外接DDR3? DDR3和外接Flash有什么区别和联系？ 8548 • 如何用中档FPGA实现高速DDR3存储器控制器？ 3011 • 如何提高DDR3的效率 9141 • FPGA怎么对引脚进行分块？DDR3与FPGA的引脚连接 8056 • FPGA外接DDR3，引脚配置完成后，编译出现如下错误 11343 • 基于FPGA的视频图形显示系统的DDR3多端口存储管理设计 2228 • 如何去实现高速DDR3存储器控制器？ 1416 • 请问FPGA与DDR3是否必须放置在同一层？ 2784 • DDR3 SDRAM的简单代码如何编写 2878 • 关于FPGA外部的DDR3 DRAM怎么回事 2878 5个回答

答案对人有帮助，有参考价值 0 坐等坐等坐等坐等

2016-2-17 18:18:29 评论举报 yangtuzi2016

答案对人有帮助，有参考价值 0 xilinx的DDR的ip核有个最大带宽，具体你可以看下手册

2016-2-17 20:37:30 评论举报南盗

答案对人有帮助，有参考价值 0 你自己建议一个DDR的IP工程，然后去看xilinx的UG就行了。

2016-2-17 20:38:48 评论举报南盗

答案对人有帮助，有参考价值 0 南盗发表于 2016-2-17 20:38 你自己建议一个DDR的IP工程，然后去看xilinx的UG就行了。好的，谢谢！20字符，20字符，20字符，20字符。

2016-2-18 09:15:37 评论举报 yangtuzi2016

答案对人有帮助，有参考价值 0 南盗发表于 2016-2-17 20:38 你自己建议一个DDR的IP工程，然后去看xilinx的UG就行了。我看了建立IP时链接的文档ug586_7Series_MIS.pdf这个文档，上面好像没写怎么计算带宽。

2016-2-18 10:45:37 评论举报 yangtuzi2016

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