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关于XILINX多片DDR2的硬件设计和MIG

7569 DDR2

问答对人有帮助，内容完整，我也想知道答案 0 本帖最后由 elecfans跑堂于 2015-9-14 09:21 编辑最近在做FPGA板子用了两片16位的FPGA，在MIG中发现ODT 和CK CS等信号需要分别连接到FPGA。如下图，是我在MIG中设置的问题吗？还是xilinx DDR2 MIG就要求这么做？ 0 1.jpg (27.66 KB, 下载次数: 16) 已退回1积分
2015-9-13 14:21:32　　评论淘帖0 邀请回答您可以邀请以下用户，快速回答问题 × 刘英该类别下有 31 个回答。邀请回答 chenbingjy 该类别下有 27 个回答。邀请回答 yoonssica 该类别下有 22 个回答。邀请回答 houxiaoxiao 该类别下有 17 个回答。邀请回答小工兵该类别下有 16 个回答。邀请回答小萃米该类别下有 16 个回答。邀请回答 Elecfans管家该类别下有 15 个回答。邀请回答我爱妖妖该类别下有 14 个回答。邀请回答言尽于此33 该类别下有 14 个回答。邀请回答薄迪该类别下有 14 个回答。邀请回答 hxing 该类别下有 13 个回答。邀请回答那些年儿ing 该类别下有 13 个回答。邀请回答平漂流该类别下有 13 个回答。邀请回答小麦地该类别下有 12 个回答。邀请回答科比如我该类别下有 12 个回答。邀请回答倪love 该类别下有 12 个回答。邀请回答 xiekaboy 该类别下有 12 个回答。邀请回答 1653344032.827400 该类别下有 12 个回答。邀请回答 2013crazy 该类别下有 11 个回答。邀请回答英雄孤寂该类别下有 11 个回答。邀请回答举报 h1654155744.7435 相关推荐 • Xilinx ISE的mig生成ddr2 5210 • xilinx MIG DDR2使用问题 3904 • 如何在ML505板上移植DDR2控制器？ 748 • 怎么将DDR2 SDRAM连接到Virtex-4QV FPGA？ 1372 • 可以创建一个MIG.DoseMIG支持DDR2吗？ 1214 • 请问没有VDMA IP核可以将数据从DDR2发送到HDMI输出吗？ 2002 • 哪里可以找到virtex-5中ddr2的mpmc约束的例子？ 1252 • 找不到DDR2信号 847 • 可以使用mig生成ddr控制器吗？ 990 • 如何添加atlys主板上的DDR2时序配置？ 1250 4个回答

答案对人有帮助，有参考价值 0 设置的问题

2015-9-24 18:10:41 评论举报 913688247

答案对人有帮助，有参考价值 0 913688247 发表于 2015-9-24 18:10 设置的问题我看了一些官方的设计也是需要分别连接的

2015-9-25 15:27:36 评论举报 h1654155744.7435

答案对人有帮助，有参考价值 0 cs应该可以直接拉死的，在设置里头有的，ck和odt好像是现在做了约束了，core gen必须要检查到管脚约束才能进行下一步。

2015-9-27 12:16:13 评论举报 myself2004

答案对人有帮助，有参考价值 0 感谢楼主分享！！！！！！！！

2015-10-14 16:43:56 评论举报 fwing

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