[问答]

ISE多周期时序约束

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问答对人有帮助，内容完整，我也想知道答案 0 有没有哪位大神对ISE的时序约束比较熟悉，尤其是多周期约束这一块。在Quartus中使用比较简单，而且相关资料也比较多，但是ISE中的资料好像不是那么多，而且也没有针对具体例子进行分析。官网上给出的例子是如下形式的： NET "clk_a" TNM_NET = "clk_a"; tiMESPEC "TS_clk_a" = PERIOD "clk_a" 10.0 ns HIGH 50%; NET "clk_b" TNM_NET = "clk_b"; TIMESPEC TS_FastPath = FROM clk_a TO clk_b 20 ns; 而我们的违规路径多是从某个模块下的寄存器到另一个模块下的寄存器，时序分析报告中会给出具体的路径。在QII中可以针对这条路径进行多周期约束（无论是setup违规还是hold违规），而且路径的源点和终点即使报告中给出的。但是在ISE中好像不是这样，首先是官网资料中没有提及到对setup以及hold的约束，只有一个统一的称呼即from to（见上例），这种约束应该是针对时钟的约束，实用性好像不是那么大。后来我在官网资料中又看到了一种约束方法，即使用INST以及TNM对违规路径进行重新命名，然后用TIMESPEC进行约束，见下例： INST uut/m1/n1/reg1/data1 TNM=source_data; INST uut/m2/n2/reg2/data2 TNM=destination_data; TIMESPEC TS_TS_FastPath = FROM source_data TO destination_data TS_clk*2; 上例中INST之后的即是具体路径的源点和终点（具体名字是我随便起的，大家可以忽略），我按照这种方法在ISE中进行了约束，结果还是一样。我在想，官网资料出错的可能性几乎没有，那就是我理解和使用的错误，所以请各位大神指点一下到底该怎么用，不胜感激！！！ 0
2015-4-30 09:52:05　　评论淘帖0 邀请回答您可以邀请以下用户，快速回答问题 × 刘英该类别下有 31 个回答。邀请回答 chenbingjy 该类别下有 27 个回答。邀请回答 yoonssica 该类别下有 22 个回答。邀请回答 houxiaoxiao 该类别下有 17 个回答。邀请回答小工兵该类别下有 16 个回答。邀请回答小萃米该类别下有 16 个回答。邀请回答 Elecfans管家该类别下有 15 个回答。邀请回答薄迪该类别下有 14 个回答。邀请回答我爱妖妖该类别下有 14 个回答。邀请回答言尽于此33 该类别下有 14 个回答。邀请回答 hxing 该类别下有 13 个回答。邀请回答那些年儿ing 该类别下有 13 个回答。邀请回答平漂流该类别下有 13 个回答。邀请回答 1653344032.827400 该类别下有 12 个回答。邀请回答小麦地该类别下有 12 个回答。邀请回答科比如我该类别下有 12 个回答。邀请回答倪love 该类别下有 12 个回答。邀请回答 xiekaboy 该类别下有 12 个回答。邀请回答 2013crazy 该类别下有 11 个回答。邀请回答英雄孤寂该类别下有 11 个回答。邀请回答举报阿兮相关推荐 • Spartan-3 DCM需要哪些时序分析约束？ 1547 • 设计中的关键路径如何约束 1278 • 如何满足时序约束？ 1351 • 请教时序约束的方法 3272 • 请问时序约束文件SDC支持哪些约束？ 372 • 关于时序约束，该怎么开始？ 11022 • 关于时序约束的文件 2785 • 求时序约束设置 2708 • UCF中的时序约束在组合设计中被忽略了？ 1935 • DCM输出时钟约束的示例 3589 1个回答