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[经验]

Xilinx FPGA设置引脚带内部上拉电阻

2013-10-11 20:59:26

17673

0

大家好！想请教一下，Xilinx FPGA可以设置引脚带内部上拉电阻吗？怎么设置？

设置上拉电阻.jpg (53.16 KB, 下载次数: )

设置上拉电阻.jpg

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2 条评论

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happylizhi 2013-10-12 09:58:59

可以在引脚约束时设置PULL UP或者PULL DOWN

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孙冬 2013-10-12 12:47:30

happylizhi 发表于 2013-10-12 09:58
可以在引脚约束时设置PULL UP或者PULL DOWN

你好，请问是这样设置吗？在Generate Programming File上右键单击下的Properties下修改吗？就像我下图那个图片那样。但是，这里只有特定的一些引脚啊？比如Configuration Pin M0、JTAG Pin TCK等，我要修改我指定的一个引脚应该怎么做？

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