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求助，关于LMX2572LP多片时钟芯片同步的疑问求解

问答对人有帮助，内容完整，我也想知道答案 0 手册中关于同步的描述：在OSCin的上升沿捕获sync的上升沿，经过t1,两片pll的输出同步上，t2为输出与参考时钟的确定性的延迟时序要求：tcs_min=2.5ns,tch_min=2ns OScin是100M的时钟，OScin与SYNC满足时序要求，但是pll输出的时钟信号同步不上。每SYNC一次，两片pll输出的时钟相位差会变化一次，但是未同步 pll的配置如下： 0 本主题由 Harmony威廉希尔官方网站专家于 2024-11-8 18:05 审核通过
2024-11-8 09:04:04　　评论淘帖0 邀请回答您可以邀请以下用户，快速回答问题 × 新星之火12138 该类别下有 59 个回答。邀请回答 heks 该类别下有 59 个回答。邀请回答普罗旺斯的薰衣草该类别下有 55 个回答。邀请回答 lksas 该类别下有 47 个回答。邀请回答 wang21cj 该类别下有 46 个回答。邀请回答 chm5 该类别下有 45 个回答。邀请回答 hgimtk 该类别下有 45 个回答。邀请回答颜刚YanG 该类别下有 43 个回答。邀请回答 fdhsfagd 该类别下有 42 个回答。邀请回答 zhhx1985 该类别下有 41 个回答。邀请回答 huzp_bbs 该类别下有 41 个回答。邀请回答 ggfx 该类别下有 41 个回答。邀请回答站着幻想该类别下有 41 个回答。邀请回答 K_Ming 该类别下有 40 个回答。邀请回答风动影随该类别下有 40 个回答。邀请回答潘涛12345 该类别下有 39 个回答。邀请回答 kghfh 该类别下有 39 个回答。邀请回答 zhouxk 该类别下有 39 个回答。邀请回答 kingnet6688 该类别下有 38 个回答。邀请回答 60user103 该类别下有 38 个回答。邀请回答举报 lotusp 相关推荐 • 请问LMX2572在使用过程中当OSCin选择单端输入时，外部时钟信号必须从OSCinP引脚输入？ 149 • 请问频率合成器像LMX2594，LMX2595，LMX2694这类芯片的同步功能是都需要在整数分频模式下才能同步吗？ 134 • 多片AFE5818的输入ADC时钟为同步时钟，不同的芯片上LVDS串行数据时钟和帧时钟是否是同步的？ 64 • 如果系统中使用多片功放芯片TAS5622A，如何实现时钟同步？ 130 • 请问AD9520有多芯片同步功能吗？ 2133 • 使用LMX2594能否进行FSK调制，实现两个频率点的跳频，需要通过配置哪些寄存器完成？ 243 • 请问AD9637和LTC2323-12同步采样有什么不同？ 401 • 如何同步54LP的ADC？ 1101 • 关于芯片lmx2571 4079 • 请问如何将多片AD9361芯片进行相位同步 6605 1个回答

答案对人有帮助，有参考价值 0 根据您提供的信息，您正在尝试同步两片LMX2572LP时钟芯片。在这种情况下，您需要确保时序要求得到满足，并且PLL配置正确。以下是一些可能的解决方案和建议： 1. 检查时序要求：确保OSCin和SYNC信号满足手册中提到的时序要求，即tcs_min=2.5ns和tch_min=2ns。如果这些要求没有得到满足，可能会导致PLL输出的时钟信号无法同步。 2. 检查PLL配置：确保两片PLL的配置相同。这包括输入频率、分频比、相位偏移等参数。如果配置不同，可能会导致输出时钟信号的相位差变化。 3. 检查同步信号：确保SYNC信号的上升沿与OSCin的上升沿对齐。如果SYNC信号的上升沿与OSCin的上升沿不同步，可能会导致PLL输出的时钟信号无法同步。 4. 检查电源和地线：确保两片PLL的电源和地线连接正确且稳定。不稳定的电源或地线可能会导致PLL输出的时钟信号不稳定，从而影响同步。 5. 检查时钟分配网络：确保时钟分配网络（如时钟树）设计合理，以减少时钟信号的传播延迟和相位误差。不合理的时钟分配网络可能会导致PLL输出的时钟信号无法同步。 6. 考虑使用外部时钟源：如果内部时钟源无法满足同步要求，可以考虑使用外部时钟源来同步两片PLL。这可以通过将外部时钟源连接到两片PLL的参考输入端来实现。 7. 检查芯片手册和应用笔记：仔细阅读LMX2572LP的芯片手册和应用笔记，以确保您了解所有相关的威廉希尔官方网站细节和最佳实践。这可以帮助您更好地理解如何配置和同步PLL。 8. 寻求威廉希尔官方网站支持：如果以上建议都无法解决问题，可以考虑联系芯片制造商的威廉希尔官方网站支持团队，以获取更专业的帮助和建议。希望这些建议能帮助您解决两片LMX2572LP时钟芯片同步的问题。

2024-11-9 09:29:34 评论举报孙成红