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想请教一个STM32的AD问题:如何确定ADC的时钟频率(信号的采用频率)?
首先:STM32手册给出的 t=1.5,7.5,...239.5 是采样保持的时间,对吧,再加上12.5个周期的纯转换时间,这样stm32的总转换时间TCONV即为二者之和; 比如:一个信号20HZ的信号,最高频率为50HZ;用STM32的AD采样;我的思路是这样: 根据采样定理:采样频率 fs>=2fmax =100HZ; 取STM32的AD采样频率为200HZ ; 这样 采样时间=(1/200)s;(即间隔多长时间取样并转换一个数据) 而 TCONV = (t+12.5)*T = (t+12.5)/ fAD (t为1.5,7.5等,fAD为AD时钟); 这样就得到:1/200 = (t+12.5)/fAD , 所以: fAD=(t+12.5)*200 , 根据t最大为239.5,这样fAD最大为50400HZ; 不符合STM32手册中给出的AD特性的时钟范围(0.6MHz-14MHZ); 这个推理过程没有问题吧,为什么会出现上面的问题呢? 希望能得到指教。 而且我实际设置的时候,根据sysclk 168MHz,Hclk 168MHz, Pclk2 84Mhz,Pclk1 42MHz ADC时钟设置的ADC_Divider 为2,这样得出来的 ADC_Clk为42MHz,要比官方宣称的大很多,这样实际采样的时候也没问题 |
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1个回答
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在STM32中,确定ADC的时钟频率(信号的采样频率)是一个重要的步骤,因为它将影响到ADC的采样速度和精度。以下是确定ADC时钟频率的步骤:
1. 首先,了解信号的特性。在这个例子中,信号的最高频率为50Hz。 2. 根据奈奎斯特采样定理,采样频率(fs)应至少是信号最高频率(fmax)的两倍。在这个例子中,fs >= 2 * fmax = 100Hz。 3. 选择一个合适的采样频率。在这个例子中,我们选择200Hz作为采样频率,这样可以确保满足奈奎斯特采样定理的要求。 4. 计算采样时间。采样时间(Ts)是采样频率的倒数,即Ts = 1/fs。在这个例子中,Ts = 1/200 = 0.005秒。 5. 确定ADC的总转换时间(TCONV)。TCONV包括采样保持时间(t)和纯转换时间(12.5个周期)。采样保持时间(t)取决于STM32的ADC配置,可以是1.5、7.5、15、30、55、85、145、205或239.5个ADC时钟周期。纯转换时间是固定的,为12.5个周期。 6. 计算ADC时钟周期(TADC)。TADC = TCONV / fAD,其中fAD是ADC的采样频率。在这个例子中,我们需要找到一个合适的ADC时钟频率,使得TADC满足我们的采样时间要求。 7. 根据STM32的数据手册,查找ADC时钟频率(fADC)与系统时钟(fSYS)之间的关系。通常,fADC = fSYS / (2 * (PCLK2 / 2^(ADC clock prescaler)) * (ADC clock divider))。 8. 根据上述公式,计算合适的ADC时钟预分频器(ADC clock prescaler)和ADC时钟分频器(ADC clock divider)的值,以满足我们的采样时间要求。 9. 在STM32的ADC配置中设置这些参数,以实现所需的采样频率和精度。 通过以上步骤,我们可以确定STM32的ADC时钟频率,以满足特定信号的采样要求。在实际应用中,可能需要根据具体的硬件配置和性能要求进行调整。 |
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