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在AD电路设计中,因为外部干扰较大的原因,在AD芯片7606的3、4、5、9-15引脚接入了2K下拉电阻,测试中发现3.3V的复位信号变为了0.8V的复位信号,这是什么原因?是这些引脚不能接下拉电阻吗?这个原理图设计上还有别的问题吗?
原理图如下: 在这里先谢谢各位了!!! |
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1个回答
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正常来说, 数字IO都是相同的, 建议更换芯片看一下吧, 是否也出现了同样的现象
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