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66AK2H12的中文资料

2023-9-28 08:16:35 510 dsp 信号处理器

0 1设备概述 1. 1.1特点1 •八个TMS320C66x DSP核心子系统（C66x CorePac），每个 –1.0 GHz或1.2 GHz C66x固定和浮点DSP核心 –38.4 GMacs/核心，用于1.2 GHz的固定点 –19.2 GFlop/浮点数为1.2时的堆芯千兆赫 –内存 –每个CorePac 32 KB L1P –每个CorePac 32 KB L1D –每个CorePac 1024-KB本地L2 •ARM CorePac –四个ARM®Cortex® -A15 MP核心™ 处理器高达1.4 GHz –四个ARM共享4MB的二级缓存岩心 –ARMv7-A体系结构的全面实现指令集 –每个核心32-KB的一级指令和数据缓存 –AMBA 4.0 AXI相干扩展（ACE）主端口，连接到MSMC，用于对共享MSMC SRAM的低延迟访问 •多核共享内存控制器（MSMC） –6MB MSM SRAM内存由八个共享 DSP核心处理器和一个ARM核心处理器 –两个MSM的内存保护单元（MPU） SRAM和DDR3_EMIF •多核导航器 –16k多用途硬件队列队列管理器 –零开销的基于数据包的DMA 转让 •网络协处理器 –数据包加速器支持 –传输平面IPsec、GTP-U、SCTP、PDCP –L2用户平面PDCP（RoHC，空气加密） –1.5时的1Gbps线速吞吐量每秒MPackets –安全加速器引擎支持 –IPSec、SRTP、3GPP和WiMAX Air 接口和SSL/TLS安全性 0 66AK2H12中文资料.pdf 2 Bytes , 下载次数: 0
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