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ARM Cortex-A510核心威廉希尔官方网站参考手册

2023-8-9 07:50:45 573 ARM Cortex A

0 Cortex®-A510核心是一款实施ARM®v9.0-A架构的高效率、低功耗产品。ARM®v9.0-A架构将ARM®v8-A架构中定义的架构扩展至ARM®v8.5-A。 Cortex®-A510核心在DSU-110Dynamiq™集群内实施，并始终连接到Dynamiq™共享单元-110(DSU-110)。DSU-110与L3缓存和监听控制完全互连。此连接配置也可用于具有不同类型内核的系统，其中Cortex®-A510是高效内核。 Cortex®-A510内核在称为联合体的模块中实施，该模块最多包含两个内核。在双核复合体中，向量处理单元(VPU)、L2转换后备缓冲器(TLB)和L2高速缓存逻辑在核心之间共享。 0 IMP_ATCR_EL1, CPU 辅助翻译控制登记册.pdf 6 Bytes , 下载次数: 5
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