FPGA零基础学习：SDR SDRAM驱动设计实用进阶

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SDR SDRAM驱动设计实用进阶

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在一些工程设计中，SDR SDRAM作为中间数据缓存器，往往需要接收上游传输过来的数据，并且还要输出下游所需的数据。为了能够解决下上游传输数据的需要，经常在SDR SDRAM驱动器中加入输入和输出缓冲器（FIFO）。为了能够使SDR SDRAM控制器能够独立自主的读取输入FIFO的数据到SDR SDRAM，以及SDR SDRAM到输出FIFO中，中间需要加上一个控制模块。控制模块中需要符合一定的项目设计规则。

      SDR SDRAM是支持页突发的，可以一次进行整行数据的输入或者读出。当有大量数据时，页读和页写是经常用到的。

      页读和页写并不是每次都必须读写整个行，我们可以利用突发终止命令将其终止掉。

      下面两个时序就是SDRAM的页读页写时序，在某个位置使用突发终止命令将其终止掉。

      页写被终止时序图：

页读被终止时序图：

具体的参考设计请参考图像显示系统设计。