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我正在使用 NUCLEO-L552ZE-Q 并制作了一个非常简单的测试电路来测试漏极开路输出信号。我将引脚配置为漏极开路输出,没有上拉或下拉,信号通过 1K 电阻上拉至 3.3V。当我设置引脚时,我在 1K 电阻的底部看到一个 3.3V 信号探测,当我清除引脚时,我看到一个 0V 信号。这与我的预期相反?是否有一些反相缓冲器连接到 FET 的栅极?
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1个回答
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这是预期的行为。如果你设置推挽输出模式,这显然是应该的方式。当您设置开漏时,唯一的区别是上面的 PMOS fet 始终处于开路状态(高阻抗)。
另请参阅 AN4899 应用说明“用于硬件设置和低功耗的 STM32 GPIO 配置”。 |
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