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今天做题时碰到了一个让人非常头疼的问题,是一道涉及到计算机组成原理知识点的题目,本以为通过之前书上讲的普通方法便可立即解出此题,但跃跃一试一番后,发现自己却错地一塌糊涂,于是便打开参考答案仔细研究了一番,可琢磨了好一阵子后还是一头雾水,因此只好去网上搜资料,看有没有大佬能够给出片选信号逻辑表达式求解的详细流程来观摩一番,可是翻来覆去,还是没有找到令人满意的答案,要么是感觉大佬们的话语有些深奥,要么是感觉大佬给的信息量对于我这个菜鸟来说有些支离破碎,因此自己折腾了好一阵子还是没有摸清任何头绪…
经过了一番纠结后,我打开了平常打草稿的笔记本,在上面随便涂鸦起来,可就在一千钧一发之际,我不经意地瞥了一眼之前研究数据结构算法设计中动态规划时打的草稿中自己归纳的一句话:“要求大问题,先求小问题。” 就在这时,我灵机一动,像是明白了什么。我再重新看了一遍题目,把题目中的主要关键名词和关键数据都审视了一番,看看自己对于这些名词和数据是否都真正理解透了,后面我便把所有自己所想的与网上百度百科给出的权威解释逐一进行对比,发现了一个令人震惊的结果——我所认为我知道的可能并不是真正正确的! 于是之后我便通过百度百科上的权威解释和网上各位大佬的综合解答把这道题目中的关键名词和关键数据给重新认识了一番,最后再做一遍时果然得出了正确的结果。 我想这可能或许就是考研的魅力吧,它让我片刻停下了驴子般的生活,开始真正地思考了起来,平时自己都是过于浮躁,做题时太过于浮躁,太过于注重于结果,而忽略了过程,忽略过了由来,自然搞不清最终的结果。 貌似扯得有点多了,那接下来就让我们进入正题吧~ 首先题目如下: 设某机中,CPU的地址总线A15 ~ A0,数据总线D7 ~ D0(A0,、D0位为最低位),存储器地址空间为3000H~67FFH。其中3000H ~ 4FFFH为ROM区,选用4K×2的ROM芯片,5000H ~ 67FFH为RAM区,选用2K×4的SRAM芯片。请问:
(1)、已知数据总线为8位,ROM区为3000H~4FFFH,故ROM容量为8K×8(8K是根据4FFFH与3000H相差的内存大小化成二进制计算得来的),ROM芯片数=8K×8/4K×2=8片(分为2组,每组4片).RAM区为5000H ~ 67FFH,故RAM容量为6K×8,SRAM芯片数 = 6K×8/2K×4=6片(分为3组,每组2片)。 (2)、ROM芯片的容量为4K×2,具有12(4K=2^12)根地址线、2根数据线,因此ROM芯片的地址线连接CPU地址线的低12位A11 ~ A0,每组ROM的4个芯片分别连接CPU数据线的D7D6、D5D4、D3D2、D1D0。SRAM芯片的容量为2K×4,具有11根地址线、4根数据线,因此SRAM芯片的地址线连接CPU地址线的低11位A10 ~ A0,每组SRAM内的2片芯片分别连接CPU数据线的D7D6D5D4、D3D2D1D0。 (3)、ROM区有2个片选信号(片选信号数目由分组数目确定),RAM区有3个片选信号,共需5个片选信号,根据地址分配的要求,各片选信号的逻辑表达式如下(其中CS0、CS1用于ROM区片选,CS2、CS3、CS4用于RAM区片选): CS0=A15非A14非A13A12, CS1=A15非A14A13非A12非 CS2=A15非A14A13非A12A11非 CS3=A15非A14A13非A12A11 CS4=A15非A14A13A12非A11非 最后以CS0与CS1的求法为例着重解析一下:ROM区的内存地址为3000H~4FFFH,有两个片选信号,则此内存区域被分割成了两个子内存区域3000H ~ 3FFFH,4000H ~ 4FFFH,因为ROM区中ROM芯片的地址线连接CPU地址线的低12位A11 ~ A0,所以还有A15、A14、A13、A12未用,因此ROM区的片选信号将由A15、A14、A13、A12这四位确定。对于子内存地址3000H ~ 3FFFH,其对应的A15、A14、A13、A12位分别为0、0、1、1,所以其片选信号的逻辑表达式为A15非A14非A13A12,对于子内存地址4000H ~ 4FFFH,其对应的A15、A14、A13、A12位分别为0、1、0、0,所以其片选信号的逻辑表达式为A15非A14A13非A12非。对于RAM区用同样地方法将内存地址分割成三个子内存地址5000H ~ 57FFH, 5800H ~ 5FFFH, 6000H ~ 67FFH,即可求得相应结果。 |
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