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1.总线的基本概念
计算机系统的五大部件之间有两种互连方式
总线传输的是一位一位的二进制代码。 这是两个以CPU为中心的总线结构: 这是以存储器为中心的双总线结构: 2.总线的分类 根据不同的分类方法:
芯片内部的总线,如在CPU的芯片内部,寄存器之间,寄存器与ALU之间,等等部件之间。 2.2 系统总线 CPU、主存、I/O设备各大部件之间的信息传输线,这些部件通常安放在主板或者各个插件板上,所以也称为板级(板间)总线。 按照总线传输的信息的不同,又可分为三类:
2.3 通信总线 用于计算机系统之间或者计算机和其他系统之间的通信,按照传输方式可以分为串行、并行两种通信。
串行通信适宜于远距离,可以从几米数达几千公里。 不管是串行还是并行数据传送的速率都与距离成反比。 在短距离内,并行数据传送速率比串行高。 对于远距离通信,串行通信费用比并行要低很多,此外串行通信还可以利用现有的电话网络来实现远程通信,降低了通信费用。 3.总线特性及性能指标 3.1 总线特性
3.3 总线标准 流行的几种总线标准:
主要特点:
4.总线结构 4.1 单总线结构 4.2 多总线结构 双总线结构特点:将速度较低的I/O设备从单总线上分离从胡来,形成主存总线与I/O总线分开的结构。 通道:具有特殊功能的处理器,CPU将一部分功能下放给通道,使其对I/O设备具有统一管理的功能,以完成外部设备与主存储器之间的数据传送,其系统的吞吐能力可以相当大,多用于大、中、型计算机系统。 下图的主存总线用于CPU与主存之间信息的传输,I/O总线供CPU与各类I/O设备之间的传递信息,DMA总线用于高速I/O设备与主存之间直接交换信息。 另一种三总线结构: 处理器和Cache(高速缓存)之间有一条局部总线,它将CPU与Cache或与更多的局部设备连接,Cache的控制计技不仅将Cache连到局部总线上,而且还直接连到系统总线上,这样Cache就可通过系统总线与主存传输信息,而且I/O设备与主存之间的传输也不必通过CPU。 扩展总线,它将局域网、小型计算机接口、调制解调器以及串行接口等都连接起来,并且通过这些接口又可与各类I/O设备相连,因此它可以支持相当多的I/O设备。于此同时,扩展总线由通过扩展总线接口与系统总线相连,由此便可以实现这两种总线之间的信息传递,系统工作效率明显提高。 4.3 总线结构举例 传统微型计算机的总线结构: 5.总线控制 总线上连接着多个部件,什么时候由哪个部件发信息,如何给信息传送定时,如何防止信息丢失,如何避免多个部件同时发送,如何规定接收信息的部件等一系列问题都需要由总线控制器统一管理。它主要包括判优控制(仲裁逻辑)和通信控制。 5.1 总线判优控制 总线上连接的各类设备,对总线有控制功能的叫做主设备(主模块),没有的控制功能的叫做从设备(从模块),主设备对总线有控制权,从设备只能响应从主设备发来的总线命令。 某个主设备要与一个从设备进行通信时,首先由主设备发出总线请求信号,如果多个主设备同时要使用总线,那么就需要由总线控制进行判优,按照一定的优先级确定哪个主设备先使用总线。 总线判优控制可分为两种:
在众多设备争夺总线使用权的时候,应按各部件的优先等级来决定,也就是总线判优控制。 在通信时间上,则应按分时方式来处理,即以获得总线使用权的先后顺序分时占用总线,即哪一个部件获得使用权,此刻就由它传送,下一部件获得使用权,接着下一时刻传送,这样一个接一个轮流交替传送使用权。 通常将完成一次总线操作的时间称为总线周期:
通常的四种通信控制方式: 同步通信: 通信双方由统一时标控制数据传送 时标通常由CPU的总线控制部件发出,送到总线上的所有部件,也可以由每个部件各自的时序发生器发出,但必须由总线控制部件发出的时钟信号对他们进行同步。 异步通信 异步通信克服了同步通信的缺点,允许各模块速度的不一致性,给设计者充分的灵活性和选择余地,它没有公共的时钟标注,不要求所有部件严格的统一操作时间,而是采用应答方式(握手方式),即当主设备发出请求,一直等到从设备反馈响应信号,才开始通信。当然,这就要求主、从设备之间增加两条应答线(握手交互信号线)。 异步通信分为三种类型:
波特率:单位时间内传送二进制数据的位数,单位bps(位/秒)表示,记作波特。
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