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嗨，
我在我的定制设计中使用了Artix-7 XC7A50T-2LE。 我的主板上有两个DDR3L，我将使用两个独立的MIG +微型激光器。 我有一个过热的问题。 FPGA的温度约为70-90度，具体取决于设计。 这里对整个电路板功率进行了一些测量：1）。 无配置，晶体发生器关闭----- 0.75W（P1）2）。 配置（MB +一个DDR3L），晶体发生器关闭----- 1.3W（P2）3）。 配置（MB +一个DDR3L），晶体发生器----- 2.05W（P3） 据我所知，P3-P2 = 0.75W - 是我项目真正的动态力量。 我认为这是真的，因为：0.75W = 0.113W（直流 - 直流效率为-15％）+ 0.48W（来自XPE的动态值）+ 0.15W（DDR3L IC动态为800mb / s）。 但是，静态电源会发生什么？ 我的意思是P2-P1 = 0.75W。 我的XPE静态值约为0.075W！ 什么会导致静态电源的这个问题？ 我试图将VCCIN从1.0v改为0.9v。 但事实上，它并没有帮助。 这是我项目的电力报告： 非常感谢。 
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3个回答
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- 静电可能导致这个问题？
静态功耗主要是由于芯片的静态功耗。 静态功率是由于芯片中晶体管的反向偏置漏电流。 静态功率也与电压立方体成比例。 因此降低VCCINT电压并在某种程度上可以明显降低静态功率。但它根本没有太大变化。 仅供参考：请参阅以下链接文档，以了解有关7系列FPGA静态电源的更多信息。 http://www.xilinx.com/support/documentation/white_papers/wp436-Power-Leadership-28nm.pdf http://www.xilinx.com/support/documentation/white_papers/wp221.pdf _______________________________________________如果有助于解决您的查询，请将此帖子标记为“接受为解决方案”。 因此，它将有助于其他论坛用户直接参考答案。如果您认为该信息有用且面向答复，请给予此帖子称赞。 |
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如果我不得不猜测，因为你正在测量整个电路板的功率，你使用Artix-7配置但未计时的“静态功率”可能是由IO引脚上的负载引起的。
例如，如果打开外部存储器的地址和控制信号驱动器，并将电路板级别端接到Vtt，则会突然增加功率，尤其是在所有线路驱动为低电平时。 然而，除非驱动器没有足够的强度将终端一直拉到地或电源轨，否则这些功率将主要在终端组件中消散，并且不会对Artix-7本身的加热产生影响。 驱动电路板上另一个有效信号的IO引脚也会增加功耗并加热FPGA本身。 请注意，Xilinx定义的“静态功耗”不包括任何IO驱动器，无论设计是否加载，都应该相同。 IO功率可以来自使用DCI，特别是如果您使用并行输入终端。 一种想法是，当芯片首次出现时IO信号的状态对于功率测量来说并不理想。 您是否可以允许时钟运行一段时间然后停止它以查看您测量的功率是否更低？ - Gabor |
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你有没有解决这个问题。
我看到了我的Artix 7A 100 -1部件的确切问题。 加载配置位流并且FPGA保持用户复位（fPGA逻辑中没有任何活动，直到复位被释放），我看到1.35V电源上大约0.350 W，这是我的DDR3和0.850W on 一个1.8 V电源，用于bank14驱动我板上的另一个IC。 但是，当没有配置设计或者从设计中移除DDR3 mig以及驱动bank14的逻辑时，我没有看到如此高的静态功耗。 |
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