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关于如何使用GTX生成PIPE接口PCIE PHY的以下主题，有没有人有答案？ https://forums.xilinx.com/t5/7-Series-FPGAs/How-to-generate-PIPE-interface-PCIE-PHY-with-GTX/m-p/568394/highlight/true#M8256 在我选择start_from_scratch协议选择而不是pcie协议选择的情况下，生成以下输入和输出端口的GTX，其在ug476_7Series_Transceivers（GTX）.pdf和pg168-gtwizard.pdf中未提及。 我想知道如何正确连接这些信号。 soft_reset_in，dont_reset_on_data_error_in，gt0_tx_fsm_reset_done_out，gt0_rx_fsm_reset_done_out，gt0_data_valid_in，gt0_tx_mmcm_lock_in，gt0_tx_mmcm_reset_out，gt0_rx_mmcm_lock_in，gt0_rx_mmcm_reset_out，... 并且，有没有提到上述信号规格的手册？ 我使用以下工具.FPGA：Virtex7PCIe端点：用户逻辑的Gen1 4lane（供应商IP）GTX：Vivado 2014.4,7系列FPGA收发器向导版本3.4 感谢你的帮助。谢谢。 Yoshioku 
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3个回答
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你好，
这是更新的信息。 从start_from_scratch协议成功生成了用于PCIe的GTX。 PCIe链路未被认为是GTX连接错误的问题。 我改变如下，然后链接了。 soft_reset_in = 1'b0 gt0_drpclk_in = gt0_txoutclk_out; *我无法找到GTX的某些信号的解释，包括来自ug476和pg168的上述信号。 谢谢。 Yoshioku |
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请查看此ARhttp：//www.xilinx.com/support/answers/62530.html
-------------------------------------------------- ----------------------------别忘了回复，给予kudo并接受为解决方案--------- -------------------------------------------------- ------------------- |
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XAPP1184 - 在Gen2 x8和Gen3 x8配置中使用集成端点PCI Express模块进行管道模式仿真应用笔记（ver2.0,380KB）[PDF]
本应用笔记描述了将Avery Design Systems的PCI-Xactor套件BFM作为根复合体集成，其中Xilinx®7系列FPGA集成PCI Express模块作为x8 Gen2端点运行，或者Virtex-7 FPGA Gen3集成模块作为 x8 Gen3端点。 设计文件 xapp1184_xilinx_ref_pipe_sim_design_g2x8.tar.gz xapp1184_xilinx_ref_pipe_sim_design_g3x8.tar.gz 2014年2月19日 AR＃35920 - Xilinx PCI Express解决方案中心 - 文档[AR] ... XAPP1184：使用Gen2 x8和Gen3 x8配置中的集成端点PCI Express模块进行管道模式仿真：... 谢谢和RegardsBalkrishan ----------------------------------------------- ---------------------------------------------请将帖子标记为 一个答案“接受为解决方案”，以防它有助于解决您的查询。如果一个帖子引导到解决方案，请给予赞誉。 |
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