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嗨，
我有一个基本的simple_counter示例 模块顶部（clk，out，reset）; ///这里有一些基本的定义 reg [31：0]计数; //总是阻止 总是@（posedge clk0或posedge reset0） 开始 //现在不要使用重置 if（reset0）开始 计数 我可以在我的V7485板上运行这个设计，并在LED上看到4位计数变量。 我想使用这个简单的设计来测试使用ICAPE2原语的回读功能 关于此，我几乎没有基本的问题： 1.使用ICAP进行回读是否允许从LUTRAM或LUT读取实现为移位寄存器的值？ 或者我们只能回读配置寄存器吗？ 2.如何修改我的verilog代码以在我的设计中包含此ICAPE2原语并将其与AXI连接？ 3.我们如何使用来自PC主机的AXI接口向ICAP发送指令？ 我们是否使用JTAG发送命令或使用任何其他电缆/驱动程序？ 没有JTAG我们能做到吗？ 4.是否有任何可以使用ICAP测试回读的工作步骤示例？ 如何指定必须保存回读数据的路径？ 感谢您回答这些基本问题。 RGDS 萨班 
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2个回答
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您可以使用AXI HWICAPhttp：//www.xilinx.com/support/documentation/ip_documentation/axi_hwicap/v3_0/pg134-axi-hwicap.pdf虽然在PlanAhead上，您可以查看以下教程中的概念：http：//www.xilinx
.COM /支持/文档/ sw_manuals / xilinx14_1 / PlanAhead_Tutorial_Reconfigurable_Processor.pdf |
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@sampatd
我创建了一个样本设计，其中一个axi主站连接到AXI4_HWICAP xilinx IP。 现在的问题是执行回读操作。 我正在使用第三方电路板上有2个V7485T fpgas。 他们还提供了api来对这个axi master进行读/写操作。 基于此，我想了解如何使用回读步骤： 1.我可以使用axi_write api将0x2写入ICAP的CTRL寄存器 2.这将启动FPGA读取。 如果我错了，请纠正我。 我假设数据将存储在HW ICAP FIFO中 3.或者这些数据将被连续发送回axi master。 4.我的应用程序应该从哪里读取数据并存储在文件中？ 这些是非常基本的查询。 问题是要了解数据来自ICAP的位置以及如何在磁盘上获取数据 RGDS 萨班 |
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