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布局有问题
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1 条评论
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解决办法：
1，首先自己确认这么叠放没有问题，只是因为看见drc不爽的话，修改place bound的尸体层，避开drc 2，sensor这么布局是存在问题的，电容的放置和走线是存在问题，像是新手在做PCB。 3，附一张sensor的图，供参考。 |
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附图如下............
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谢谢分享
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1、传感器加上高度属性；
2、镜头的place_bound添加最大布局高度属性 另外，此类封装重叠的DRC，只要结构确认没问题，可以不用理会，单板设计中不一定需要消除每一个DRC。 |
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1835 浏览 2 评论
最近配置Cadence的共享cis库，按照相关步骤配置完成之后，调用元器件会出现原理图错误，求大佬指教
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