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嗨,
为什么要尝试为单端IO分配差分IO标准? 您在快照中显示的CLK端口未被工具检测为差分对信号。 您可以看到与CLK端口对应的“Neg Diff对”列为空。 通常,如果代码中有IBUFDS实例,则该工具会将端口检测为差分信号。 仅差分IO就可以看到LVDS。 检查这个帖子:http://forums.xilinx.com/t5/Implementation/How-do-I-tell-Vivado-that-my-signal-is-differential/td-p/332731 谢谢, 迪皮卡。 谢谢,迪皮卡.---------------------------------------------- ---------------------------------------------- Google之前的问题 张贴。 如果某人的帖子回答了您的问题,请将帖子标记为“接受为解决方案”。 如果你看到一个特别好的和信息丰富的帖子,考虑给它Kudos(左边的明星) 在原帖中查看解决方案 |
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嗨,
你能附上IO计划窗口的快照吗? 如果设计中有差分端口,则可以看到差分IO标准,如下所示。 LVDS I / O标准仅适用于HP I / O bank LVDS_25 I / O标准仅适用于HR I / O bank。 ZC702中的所有IO库都是HR库,因此您可以单独看到LVDS_25 IO标准。 有关引脚详细信息,请参阅http://www.xilinx.com/support/packagefiles/z7packages/xc7z020clg484pkg.txt 谢谢, 迪皮卡。 谢谢,迪皮卡.---------------------------------------------- ---------------------------------------------- Google之前的问题 张贴。 如果某人的帖子回答了您的问题,请将帖子标记为“接受为解决方案”。 如果你看到一个特别好的和信息丰富的帖子,考虑给它Kudos(左边的明星) |
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您可以在PlanAhead I / O引脚分配中启动LVDS,如前一篇文章中所述。
重要的是,如果更改引脚分配,请确保UCF文件中的IO约束与Board硬件匹配。 _______________________________________________如果有助于解决您的查询,请将此帖子标记为“接受为解决方案”。 因此,它将有助于其他论坛用户直接参考答案。如果您认为该信息有用且面向答复,请给予此帖子称赞。 |
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还有一件事,我用谷歌搜索,发现没有必要在VHDL源或Synthesize中指定差分信号,对吗?
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嗨,
为什么要尝试为单端IO分配差分IO标准? 您在快照中显示的CLK端口未被工具检测为差分对信号。 您可以看到与CLK端口对应的“Neg Diff对”列为空。 通常,如果代码中有IBUFDS实例,则该工具会将端口检测为差分信号。 仅差分IO就可以看到LVDS。 检查这个帖子:http://forums.xilinx.com/t5/Implementation/How-do-I-tell-Vivado-that-my-signal-is-differential/td-p/332731 谢谢, 迪皮卡。 谢谢,迪皮卡.---------------------------------------------- ---------------------------------------------- Google之前的问题 张贴。 如果某人的帖子回答了您的问题,请将帖子标记为“接受为解决方案”。 如果你看到一个特别好的和信息丰富的帖子,考虑给它Kudos(左边的明星) |
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