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不是可以直接生成倍频IP核吗 什么型号的
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用PLL试试，我没用过这么高的倍数
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举例可以用一个1MHz的信号对50Hz输入信号进行采样，然后将采样点数除以512，就可以得出倍频后也就是25.6KHz信号的采样点数，然后根据这个频率字设置信号发生器的输出频率了，不过不知道你有没有做过简易的信号发生器
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要做项目？可联系
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2019-9-16 15:28:00
评论
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FPGA怎么会接50hz的晶振呢，应该是50MHz吧，如果是倍频只能用PLL,分频可以用计数器
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