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什么是供源时钟？想必同学们一定不陌生，FPGA是一个无私的孩子，有时候会牺牲一个管脚，将自己的时钟源透过该管脚，输出给外部ic，如图7.1.1所示 ... 频率为100Mhz的fpga_clk 作为fpga的时钟信号，该fpga_clk经过 fpga内部以后，再路由某个管脚将新命名的 ext1_clk与ext2_clk输出给外部ic，100Mhz的ext1_clk与ext2_clk因此称为供源时钟。
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