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一般来说，SPI的CS是用来复位状态机的。你估计是被那些所谓硬件工程师忽悠着不用复位信号，导致比特位移出错了。
在任何时候，只要CS拉高，不管当前状态如何，Slave状态机必须马上复位；对于写操作，应当马上提交新数据。 |
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感觉你说得挺对，但是就是不明白为啥fpga在仿真的时候没问题，真正做板级验证的时候就有可能出错，fpga作为从机，其cs信号由stm32产生，并且fpga的接收时序里只有当cs为低并且检测到边沿信号时才会动作。。。我再改改，到时候把程序和波形图发上来
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我也在做STM32与FPGA用SPI通讯，你的通讯速率是多少？稳定吗？
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发现很多人都忽视复位问题。
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你好，请问可以分享下你的SPI和FPGA的通讯程序么？？
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还没调试好
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就是不稳定啊，数据容易出错
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想请教下是如何进行调试的？？因为我这边CPLD之前是写好的，但是芯片换成了32，之前的MCU已经是调试好的了，可以看一看你的SPI_Init函数和SPI数据传输发送的函数么？？
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这个和复位有啥关系？
时钟用的CPU发过来的时钟？ 个人觉得不要用CPU的时钟，因为你不清楚这个时钟的相位关系你怎么能用这个时钟来驱动数据呢？相当于是随路时钟的问题了 这个情况我觉得直接就按跨异步时钟域来处理，直接把CPU到FPGA的数据和控制信号打两拍到FPGA的时钟域，用FPGA的时钟来做采集，应该可以解决这个问题 |
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楼主代码呢？
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楼主 分享一下呗
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你是否有以下情况：
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建议确认一下FPGA端系统时钟的频率和SPI-SCK的频率。之前在做这方面的时候发现，SPI-SCK时钟太快的情况(或FPGA时钟太慢)会导致接收数据不稳定情况。一般可以降低STM32 SPI的SCK或者在FPGA端通过PLL将主频倍频至更高的频率。
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基于采用FPGA控制MV-D1024E系列相机的图像采集系统设计
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