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我的系统采用的是DDS+PLL/VCO的方式去产生一个宽带信号源，其中DDS用的是AD9912（为HMC833提供参考频率），锁相环使用的是HMC833。配置的时候只使用了HMC833的整数分频模式，即N为整数，则鉴相频率PFD=fvco/N，算出鉴相频率后AD9912再输出这个频率送至HMC的参考输入脚，鉴相频率范围为68MHz~72MHz，环路带宽为手册上推荐的90KHz,当输出频率变化小于70MHz的时候，只改变AD9912的输出，HMC833寄存器不改变。
现在遇到的问题如下： 1.在低频段（1.5GHz内）有一大片鉴相频率整数倍的杂散信号存在，杂散信号与主信号间的差距大概在65dBc左右。 2.倍频程内（3-6GHz），主信号两边的整数倍鉴相频泄露恶化的比较厉害，最差大概在-50dBc。 2.部分连续频点，HMC833的寄存器配置一样，但是输出的鉴相频率杂散差距有15db（比如在2629MHz上鉴相频率杂散为77dBc，2930MHz鉴相频率杂散恶化为60dBc，两个频点的HMC833寄存器配置是一样的，唯一不同的是AD9912供给HMC833的参考有所不同，2629MHz鉴相频率约为71.054MHz，2630MHz鉴相频率约为71.081MHz） 求解答： 1.我在数据手册上看到，HMC833的整数倍鉴相频率泄露可以抑制在100dBc左右，但是我的最差只做到的50dBc；数据手册有提到，整数倍鉴相频率杂散抑制的值跟布局布线有关系，我的板子用的是复合多层板，层分布为：信号（器件）->地->电源+环路滤波馈线 ->地，而且环路滤波馈线走线方向跟参考输入输出方向垂直； 2.整数倍鉴相频率泄露是否跟HMC833的寄存器设置有关？如果有关，跟哪个寄存器设置相关？ 真心求解答，十分感谢！ 
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8个回答
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难道大家在使用833的时候都没有遇到过这种问题？
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换一个参考输入看一下,确定你PFD 泄露的来源和路径, 从芯片内部泄露的可能性小
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参考用信号源替换试过，HMC833的输出表现还是一样； 我也怀疑过是否是布局或者布板导致，但是布局或者布板导致的话不会在一些连续的频点上出现那么大差异的PFD泄露（比如说上面的2629MHz和2630MHz）； 另外就是寄存器上好像没有可以减少或者抑制PFD泄露的选项，这个PFD的泄露是否跟某个寄存器的配置有关； |
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这个问题我也遇到过，你可以用833先出你要频率的一半，然后在二倍频。这样你的杂散可以控制离你想要的信号很远。
参考频率选大一些。 另外，你的HMC833近端杂散好吗？我测试出来很差。 |
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个人认为和寄存器配置顺序没有关系，因为我也在做这款芯片的产品；鉴相器的泄露很可能跟你的参考和环路滤波器的设计有关；另外为何不用HMC833自身的小数分频，反而用DDS来实现小数分频，DDS本身的杂散貌似也不是很理想吧？可以试试在HMC833小数分频下是否还有类似的情况！
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近端的话，与环路滤波器的相关性较少。你们的近端杂散怎么样，1Hz到1KHz。
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如果不加DDS，单独测试HMC833的话，杂散会好吗？
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楼主的杂散问题是否已经解决了？
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