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使用自己做的6678的板卡. PCIe参考时钟100MHz.
运行例程中的PCIe测试.pcie_phy_loopback. 当运行完 gpPCIE_app_regs->CMD_STATUS |= CSL_PCIESS_APP_CMD_STATUS_LTSSM_EN_MASK; 此时 LTSSM_STAT_L0 = 0x11. 但当运行 gpPCIE_CAP_implement_regs->PL_FORCE_LINK |= CSL_PCIE_CFG_SPACE_ENDPOINT_PL_FORCE_LINK_FORCE_LINK_MASK |(LTSSM_STAT_POLL_ACtiVE < 在RC模式下,PCIeSSEN =1; 2.5G,5G均试过. 1线,2线也均试过.1.8V 1.5V输入均正常.时钟也测得,并且pll锁定. 请问可能是哪里的问题? 
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