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我有一个外围设备，使用CyPress CX3作为桥集成电路，我们正在进行EMC测试提交。我们需要知道在CX3中使用的最高时钟频率，因为它支持在5Gbps的UB3.1 GEN1，我假设它有一个时钟运行在2.5GHz或5GHz内的USP3 PHY。它在2.5GHz和5GHz之间产生了很大的差异，因为FCC标准要求使用5倍的最高频率，并且没有多少个腔室能够达到25GHz。
请让我知道CX3内使用的最高时钟，这样我可以正确地计划我的测试室和测试极限。 谢谢您。 以上来自于百度翻译 以下为原文 I have a peripheral device that uses Cypress CX3 as bridge IC, and we are performing EMC tests for submittal. We need to know the highest clock frequency used in CX3, since it supports USB3.1 Gen1 at 5Gbps, I assume it has a clock running at 2.5GHz or 5GHz inside the USB3 PHY. It makes a big difference between 2.5GHz and 5GHz, because FCC standards calls for 5 times the highest frequency used, and not many chambers are capable of 25GHz. Please let me know the highest clock used inside CX3, so I can plan my test chamber and test limit correctly. Thank you. 
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3个回答
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你好，
基本上，CX3除了CSI之外还有USB超高速支持。 所以，当我看FX3 TRM PACE-92显示内部PHY有一个500兆赫的时钟。这也适用于CX3部分。 谢谢和问候， 苏德希尔 以上来自于百度翻译 以下为原文 Hi, Basically the CX3 has the USB SuperSpeed support in addition to CSI. So, when I looked at FX3 TRM Page-82 shows the Internal PHY has a clock of 500MHz. This is applicable for CX3 part also. Thank You & Regards, Sudheer |
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frank201 发表于 2018-12-4 07:09 嗨，Sudheer， 该页显示了SerDes和后续阶段之间的一个500 MHz / 10位接口。塞尔德斯内部的时钟怎么样？那个时钟是5000兆赫还是5GHz？或者SDEDES在5MHz的时钟上以某种方式进行相位偏移来采样输入数据？ 谢谢您。 郝 以上来自于百度翻译 以下为原文 Hi, Sudheer, That page shows a 500MHz/10bit interface between SERDES and the follow on stage. What about the clock used inside of the SERDES? Is that clock 5000MHz or 5GHz? Or does the SERDES somehow do a phase shift on the 500MHz clock to sample incoming data at 5Gbps? Thank you. Hao |
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puzhang549 发表于 2018-12-4 07:27 嗨，郝， 它是在5 GHz。 谢谢和问候， 苏德希尔 以上来自于百度翻译 以下为原文 Hi Hao, It is at 5 GHz. Thank You & Regards, Sudheer |
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