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我的块设计中有一个XADC,我能够从我的ARM / xmd使用“axi_lite总线”进行访问是否有一种简单的方法可以从FPGA内部发出“相同的命令”以便能够读取寄存器
。 或者正确的方法是: 使用连接到当前SAXI的MAXI接口创建一个新的axi_lite组件,然后通过新组件处理外部请求。 如果是这样,开始使用MAXI接口的最简单方法是什么? 以上来自于谷歌翻译 以下为原文 I have an XADC in my block design with I am able to access using "axi_lite bus" from my arm/xmd is there an easy way to be able to issue the "same command" from inside the FPGA to be able to read a register. Or would the correct way to go be : Make a new axi_lite compoment with a MAXI interface connected to the current SAXI and then handle external request via the new component. If so what is the easiest way to start with a MAXI interface? |
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2个回答
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@savagezayes,制作一个axi master是访问该块的唯一方法。
您可以使用工具菜单中的“创建新ip”选项从Vivado获取模板axi master。 - 如果提供的信息有用,请将答案标记为“接受为解决方案”。给予您认为有用且回复的帖子。 在原帖中查看解决方案 以上来自于谷歌翻译 以下为原文 @savageza yes, making an axi master is the only way to access that block. You can get a template axi master from Vivado by using the "create new ip" option in tools menu. - Please mark the Answer as "Accept as solution" if information provided is helpful. Give Kudos to a post which you think is helpful and reply oriented.View solution in original post |
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@savagezayes,制作一个axi master是访问该块的唯一方法。
您可以使用工具菜单中的“创建新ip”选项从Vivado获取模板axi master。 - 如果提供的信息有用,请将答案标记为“接受为解决方案”。给予您认为有用且回复的帖子。 以上来自于谷歌翻译 以下为原文 @savageza yes, making an axi master is the only way to access that block. You can get a template axi master from Vivado by using the "create new ip" option in tools menu. - Please mark the Answer as "Accept as solution" if information provided is helpful. Give Kudos to a post which you think is helpful and reply oriented. |
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