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嗨,大家好,
我有一个关于AdcSalaSeq组件的问题,我想把它弄清楚。我正在寻找一个定期的ADCXAR组件W/A顺序ADCXAR(参见使用模拟MUX/SAR ADC处理多个模拟输入/轮询速率来产生这个问题)。 使用标准的ADCXSAR + ANAMUX设置,我的项目在123/192个宏单元中使用。这给了我69的自由。ADCYSARYSEQ V2.0的数据表要求默认设置,该组件使用43个宏单元。当我试图把AcdSARSeSeq实际构建到我的项目中(删除原来的ADCXAR)时,我现在超过了199个宏单元的极限,这使得ADCsSARY-Seq使用了76个宏单元。这种巨大的差异从何而来? 原始ADCSAR: AcdSalaSeq: 以上来自于百度翻译 以下为原文 Hi all, I've got an issue with the ADC_SAR_SEQ component that I'd like to get to the bottom of. I'm looking to replace a regular ADC_SAR component w/ a Sequential ADC_SAR (see Handling multiple analog inputs/polling rates using an Analog Mux/SAR ADC for the genesis of this issue). With the standard ADC_SAR + AnaMux setup, my project weighs in at 123/192 Macrocells used. This leaves me with 69 free. The datasheet for the ADC_SAR_SEQ v2.0 claims for a default setup, the component uses 43 Macrocells. When I attempt to actually build the ADC_SAR_SEQ into my project (deleting the original ADC_SAR), I am now over the limit at 199 Macrocells, which puts the ADC_SAR_SEQ at a whopping 76 Macrocells used. Where is this huge discrepancy coming from? ORIGINAL ADC_SAR: ADC_SAR_SEQ: |
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5个回答
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嗨,Kyle,
这看起来很不寻常。你能分享这两个项目吗?项目与ADC完全相同吗? 最佳问候 以上来自于百度翻译 以下为原文 Hi Kyle, This looks unusual. Will you be able to share both projects ? Are the projects exactly identical apart from the ADC ? Best Regards, VSRS |
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谢谢你的回复, 我忘了提到,我使用的芯片是CY8C5668 AXI-LP106。 PSoC创建者4.1更新1 AcdSARY-Seq组件V2.10 这只是一个项目,在其中一个项目中,我将用序列SAR ADC取代SAR ADC,但遇到了上述问题。 我不能分享整个项目,没有跳过一堆繁文缛节,但我已经能够复制一个测试项目(附加)。 该项目只包括2个模拟引脚,测序SAR ADC,和中断。这个项目使用了76个宏单元。 如果有其他需要的信息,请告诉我。 AccTest.CyWrk.CaseV01.Zip 1.5兆字节 以上来自于百度翻译 以下为原文 Thanks for the reply, I forgot to mention, the chip I am using is a CY8C5468AXI-LP106. PSoC Creator 4.1 update 1 ADC_SAR_SEQ component v2.10 It is only one project, one in which I was just going to replace the SAR ADC with a Sequencing SAR ADC but ran into the aforementioned problem. I can't share the entire project without jumping through a bunch of red tape, but I have been able to reproduce with a test project (attached). The project consists only of 2 analog pins, the Sequencing SAR ADC, and an interrupt. 76 Macrocells are used by this project. Let me know if there's any additional information needed.
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我有一个类似的设计使用CY8C588AXI-LP096,其中7输入序列SAR ADC使用68个宏单元。我认为它可能与7个输入有关,但是2输入多路复用器也使用68个宏单元。 以上来自于百度翻译 以下为原文 I have something similar on a design using a CY8C5888AXI-LP096 where a 7 input Sequencing SAR ADC uses 68 macrocells. I thought it may have something to do with the 7 inputs, but a 2 input mux also uses 68 macrocells. |
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HI Kyle和BROCK,数据表指定使用43个宏单元进行默认配置。如果组件目录中的组件被放置到项目示意图上,并且输入/输出引脚没有任何配置连接,则称为默认配置。其他配置的宏单元使用未在数据表中列出。
最佳问候 以上来自于百度翻译 以下为原文 Hi Kyle and Brock,The datasheet specifies the use of 43 macrocells for default configuration.If component from the component catalog is placed to the Project schematic and input/output pins are connected without any configuration, it is called the default configuration. The macro cell usage for other configurations are not listed in the datasheet. Best Regards, VSRS |
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EnjoyL 发表于 2018-10-25 19:11 嗯,这就解释了为什么会有不同,所以我将标记为答案,但我还是有点担心,从差分到单端的结果,在组件的大小膨胀到原来的指定大小以上76%。 那么,我如何处理多个单端模拟输入,而不吃近40%的硬件在这个过程中? 在此之前,我做了一个线程,详细说明了我是如何通过模拟多路复用器和SAR ADC完成的,但是我质疑我的方法,并且觉得必须有一个更优雅的解决方案,我缺少了: 使用模拟MUX/SAR ADC处理多个模拟输入/轮询速率 以上来自于百度翻译 以下为原文 Well that explains why there is a difference, so I'll mark as the answer, but I'm still a bit bothered that going from Differential to Single Ended results in the size of the component bloating out to 76% above the original specified size. So how am I to handle multiple single-ended analog inputs without eating nearly 40% of my hardware in the process? I made a thread prior to this one detailing how I did this via an Analog Mux and SAR ADC, but I question my method, and feel like there must be a more elegant solution that I'm missing: Handling multiple analog inputs/polling rates using an Analog Mux/SAR ADC |
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