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我能用FPGA在SLaveFIFO模式下配置FX3GPIF数据总线宽度为24位吗?
以上来自于百度翻译 以下为原文 Can i configure the FX3 GPIF data bus width as 24bit on Slavefifo mode with FPGA ? |
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2个回答
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你好,
是的你可以配置GPIF在65974 24位。 遵循以下简单的步骤: 打开装有an65974 GPIF项目。选择左窗格中的菜单在8位数据总线宽度(如果24位总线宽度是需要选择24位)保存并点击建立& gt建设项目;建设项目产生的cyfxgpif2config .h文件4.。cy_fx_slfifo_gpif_16_32bit_conf_select设置到“0”的cyfxslfifosync H文件。 5。建设项目。这一步对8位SLAVEFIFO的应用程序生成的图像文件(二十四点Slavefifo如果24位在第三步中选定) 注意:当数据总线宽度改为8位地址线映射到GPIO 8(A1)和GPIO 9(A0),不像GPIO 28(A1)和GPIO 29(A0)在16位和32位总线宽度的情况下。同样,与24位总线宽度,地址线与GPIO 41映射(A1)和GPIO 42(A0)。地址线引脚映射可以根据控制线数量的变化,数据总线宽度,和数量的地址线选择。确保外部处理器驱动器映射到每个选定的总线宽度的GPIF接口的地址线,地址线和控制线数量多。 感谢和问候 阿比纳夫 以上来自于百度翻译 以下为原文 Hi, Yes you can configure GPIF as 24 bit in the AN 65974. Follow the following simple steps:
5. Build the project. This step generates the image file for the 8-bit Slavefifo application (for 24-bit Slavefifo if 24 Bit is selected in step 3) Note: When the data bus width is changed to 8-bit, the address lines are mapped to GPIO 8 (A1) and GPIO 9 (A0), unlike GPIO 28 (A1) and GPIO 29 (A0) in the case of both 16-bit and 32-bit bus widths. Similarly, with the 24-bit bus width, address lines are mapped with GPIO 41 (A1) and GPIO 42 (A0). Pin mapping for address lines may change based on the number of control lines, data bus width, and number of address lines selected. Ensure that the external processor drives the address lines that are mapped to the GPIF interface per the selected bus width, number of address lines, and number of control lines. Thanks & Regards Abhinav |
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谢谢Abhinav。我会使用开发工具快速评估和回到你和我的结果。 以上来自于百度翻译 以下为原文 Thanks Abhinav. I shall do a quick evaluation using development kit and get back to you with my results. |
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