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本帖最后由 一只耳朵怪 于 2018-6-22 11:18 编辑
http://www.deyisupport.com/question_answer/f/39/t/15444.aspx 我在DM8168开发，基于DVRRDK 2.80 开发包， 我使用ADV7181采集XGA信号60HZ，使用FPGA复合了两路XGA信号，送给Vport端口， 需要在使用的时候提取出来，计划写一个分离的link呢？ 但是怎么重构一个Link呢，不Link的框架不是很熟悉，好像dvrrdk里这方面介绍也比较少， 有没有达人介绍下 啊！ best regards xavier 
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你的帖子有回复的.RDK doc中有不少文档.另置顶帖中也有些说明.
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是有回复，但是每次我都没法再回复，很奇怪， 只好另外发了， 我的所有vip都用掉了， 驱动应该没有问题， 就是对link的数据交换不是很清晰 |
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有两个vip口,每个vip输入xga你应该就不用fpga进行mux了.这样你就直接通过capture link进来数据,然后将frame通过link进行交换了. |
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只有小组成员才能发言，加入小组>>
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