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使用Cyclone3，或4系列的FPGA的LVDS接口，接AD输出的并行信号，AD的采样频率250M，请问Cyclone3，或4系列的FPGA能否实现，工作频率能否达到，如EP4CE22F17I8或者EP3C25F256I7
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4个回答
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好像只有100M
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2018-6-15 20:55:01
评论
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你没说多少位的AD啊，那就不知道传输频率，传输频率只要小于芯片接口的LVDS最高速率就行了，我记得CYCLONE5的好像是800M，没用过3和4的，所以不是特别清楚
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感谢楼主。。。我也要学习。。
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只是说ADC的采样率，并没有说数据的吞吐量是多大啊，几位的ADC
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