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` Hi3519V101芯片介绍 处理器内核 A7@ 800MHz,32KB I-Cache,32KB D-Cache /128KB L2 cache A17@ 1.25GHz,32KB I-Cache,32KB D-Cache /256KB L2 cache 支持Neon 加速,集成FPU 处理单元 支持ARM® big.LITTLE 大小核架构 视频编码 H.264 BP/MP/HP H.265 Main Profile H.264/H.265 支持I/P/B 帧,支持双P 帧参考 支持MJPEG/JPEG Baseline 编码 视频编码处理性能 H.264/H.265 编码可支持最大分辨率为16M(4608x3456) Pixel H.264/H.265 多码流实时编码能力: − 3840*2160@30fps+1080P@30fps+3840*2160@2fps 抓拍 支持最大JPEG 抓拍性能3840*2160@30fps 支持CBR/VBR/FIXQP/AVBR/QPMAP 五种码率控制模式 输出码率最高支持100Mbps 支持8 个感兴趣区域(ROI)编码 智能视频分析 集成智能分析加速引擎,支持智能运动侦测、周界防范、视频诊断等多种智能分析应用 视频与图形处理 支持3D 去噪、图像增强、动态对比度增强处理功能 支持视频、图形输出抗闪烁处理 支持视频1/30~16x 缩放功能 支持两路视频无缝拼接 支持图形1/2~2x 缩放功能 8 个区域的编码前处理OSD 叠加 2 层(视频层、图形层)视频图形叠加 ISP 支持两路独立ISP 处理 支持3A(AE/AWB/AF)功能,3A 的控制用户可调节 支持去固定模式噪声(FPN)功能 支持强光抑制、背光补偿、Gamma、色彩增强 支持坏点校正、去噪、数字防抖 支持去雾 支持镜头畸变校正,支持鱼眼矫正 支持图像90 度/270 度旋转 支持图像Mirror、Flip 支持Sensor Build-In WDR、4F/3F/2F - Frame base/Linebase WDR 和Local Tone mapping,其中第二路ISP 只支持Sensor Build-In WDR、2F - Frame base/Line base WDR 和Local Tone mapping 提供 PC 端ISP tuning tools 音频编解码 通过软件实现多协议语音编解码 协议支持G.711、G.726、ADPCM 支持音频3A(AEC/ANR/ALC)处理 视频接口 输入 − 支持两路sensor输入,其中主通道最大分辨率支持到16M(4608x3456),第二路最大分辨率支持8M(4096x2160)。 − 支持8/10/12/14 Bit RGB Bayer DC时序视频输入,时钟频率最高150MHz − 支持BT.601、BT.656、BT.1120视频输入接口 − 主通路最大支持到12xLane MIPI/LVDS/Sub-LVDS/HiSPi接口 − 第二路Sensor接口最大支持4xLane MIPI/LVDS/Sub- LVDS/HiSPi接口 − 支持与SONY、Aptina、OmniVision、Panasonic等主流高清CMOS Sensor对接 − 兼容多种Sensor并行/差分接口电气特性 − 提供可编程Sensor时钟输出 输出 − 支持1路PAL/NTSC输出,支持负载自动检测 − 提供1个BT.1120/BT.656视频输出接口,用于外扩HDMI或SDI接口,最大支持1080P@60fps输出 − 支持LCD输出 音频接口 集成Audio codec,支持16bit语音输入和输出 支持I2S 接口,支持对接外部Audio codec 支持双声道Mic 差分输入,降低底噪 外围接口 支持POR 支持外部复位输入 支持内部RTC 集成3 通道LSADC 5 个UART 接口 IR 接口、I2C 接口、SSP主接口、GPIO 接口 8 个PWM 接口(4 个独立,4 个复用其它管脚) 2 个SD3.0/SDIO3.0 接口,支持SDXC 1 个USB3.0/2.0 Host/Device 接口 1 个PCIe2.0 主/从模式 支持RGMII 和RMII 模式;支持10/100 Mbps 全双工或半双工模式,支持1000 Mbps 全双工模式;支持TSO网络加速 Hi3519V101 官方开发套件 |
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