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赛灵思: 赛灵思; 收藏|RSS 经验: 9|组长: 曾12345

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如何在Kintex7 FPGA上使用MIG7控制器？	余小娟 2020-8-24	31620	余小娟 08-24 10:03
请问可以将参数传递给“*，edif”文件以包装Ip核心吗？	李秀华 2020-8-24	31162	李秀华 08-24 09:58
ADC如何捕获高达40 MHz的信号？	李凌平 2020-8-24	41271	李凌平 08-24 09:51
请问k7有hdl原语吗？	林茜 2020-8-24	31649	林茜 08-24 09:48
请问如何在具有抖动的Artix-7 GTP数据流的情况下提高CDR性能？	楚红梅 2020-8-24	31517	楚红梅 08-24 09:44
请问从kintex 7获得的最大时钟速度是多少？	h1654155275.5741 2020-8-24	53055	h1654155275.5741 08-24 09:34
XC7Z015-CLG485与XC7Z030-SBG485怎么保持兼容？	朱虹博 2020-8-24	41696	朱虹博 08-24 09:30
请问I/O Standrds LVCMOS18和LVCMOS33是否支持未校准的输入端接？	刘政玮 2020-8-24	35203	刘政玮 08-24 09:28
请问mig 7实现错误的解决办法？	庞琳 2020-8-24	64434	庞琳 08-24 09:15
为什么XADC没有转换温度结果？	李洪斌 2020-8-24	73003	李洪斌 08-24 09:01
CARRY4未连接输入的解决办法？	张新里 2020-8-24	103023	张新里 08-24 08:44
请问7系列/ Zynq设备中是否存在BUFT？	李娓仑 2020-8-24	82486	李娓仑 08-24 08:36
有没有人成功使用带有706或7系列卡的HiTech Global PCIe卡？	张敏 2020-8-24	11935	张敏 08-24 07:37
请问LVDS数据在HR库中是否能正常工作？	马秀英 2020-8-24	41378	马秀英 08-24 07:11
如何在Vivado中使用MIG设计DDR3 SODIMM接口？	楚红梅 2020-8-24	33345	楚红梅 08-24 06:45
如何从KC705的200 MHz VCO输出实现500 MHz时钟？	陈萍 2020-8-24	51378	陈萍 08-24 06:29
请问如何在VC707上构建和测试AXI以太网子系统？	王学超 2020-8-21	11881	王学超 08-21 11:07
如何在Artix-7上运行了一个1.0625 Gb / s链接进出Serdes？	杨雪 2020-8-21	11550	杨雪 08-21 11:05
在7系列和超级FPGA器件中，可以回读捕获的任何寄存器数据吗？	孙雅念 2020-8-21	31299	孙雅念 08-21 10:59
如何设计一个FMC适配卡？	王瑞 2020-8-21	6989	王瑞 08-21 10:25
将ref_clk_se路由到我的fpga的测试点或任何输出空闲引脚，我能够探测并观察时钟吗？	吴樵 2020-8-21	31495	吴樵 08-21 10:18
如何使用一个dma将数据从几个pl点传输到ddr3？	云解相 2020-8-21	61638	云解相 08-21 10:14
错误生成差分信号的解决办法？	李欣 2020-8-21	52741	李欣 08-21 10:14
CCLK用作主SPI模式问题的解决办法？	苗雨 2020-8-21	72375	苗雨 08-21 10:06
Lwip数据包接收速度太慢怎么解决？	王竹 2020-8-21	47701	王竹 08-21 09:59
请问MMCM和PLL之间的主要区别是什么？	蔡彦壁 2020-8-21	81021	蔡彦壁 08-21 09:39
如何分配大的ram空间？	赵文平 2020-8-21	91310	赵文平 08-21 09:22
在7系列FPGA中，MMCM和PLL之间是否有专用的CMT路由？	李建平 2020-8-21	22342	李建平 08-21 09:16
可以用MMCM替换PLL，然后获得适合驱动这个ISERDES代码的差分时钟输出吗？	王林 2020-8-21	143741	王林 08-21 08:24
如何为PCI Express v3.1实现了集成块？	韩婧 2020-8-21	1568	韩婧 08-21 08:15